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디지털 회로에서 논리적으로 H레벨 상태를 유지하기 위하여 신호의 입력 또는 출력단자

와 +VCC 전원 단자 사이에 접속하는 저항을 풀업 저항이라고 하며, 마찬가지고

논리적으로 L레벨 상태를 유지하기 위하여 신호의 입력 또는 출력단자와 접지 단자

사시에 접속하는 저항을 풀다운 저항이라고 한다 

 여기서는 각종 디지털 회로에서 이러한 저항을 사용하는 목적이나 이유는 무엇이며, 이들

각각의 경우에 저항값은 어떻게 결정해야 하는지에 대하여 설명한다.

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bambit 2007.10.31 11:25
풀업저항의 사용에 대한 좋은 정보예요 ^^
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뿡뿡이 2008.05.18 20:48
잘 보겠습니다. 개념이해해 도움이 될 듯 하네요~
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마이쭈 2008.08.21 11:34
와~~설계 할때 많이 들어 봤는데...감사합니다....
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낙타^^ 2009.01.13 13:56
감사
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민서아빠 2009.01.22 02:48
감사합니다 잘볼께요~
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이상호 2009.02.01 03:40
감사합니다.
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마쉘 2009.10.01 15:53
감사합니다.
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우인연구 2010.03.31 20:23

좋은자료 감사합니다.

profile
아이제미미 2010.04.07 23:40
  • 감솨
profile
winterfallym 2010.05.07 14:18
감사합니다
profile
사성제 2010.05.19 15:23
감사합니다~
profile
외환 2010.05.24 20:03
좋은자료 정말 감사합니다. 잘 보겠습니다.
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min 2011.11.24 18:20

좋은 자료 감사합니다//

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실마리온 2015.10.20 23:50

감사합니다.

profile
시나브로69 2016.12.26 19:29

좋은 자료에 감사드립니다.~~~

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snowyj 2018.09.07 13:55

좋은자료 감사드립니다 ㅎ

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